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MT3360芯片LAYOUT

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新手上路

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发表于 2014-9-27 18:12:19 | 显示全部楼层 |阅读模式

高速电路PCB网,专注于嵌入式方案,信号完整性和电源完整性仿真分析,高速电路PCB设计,各种EDA工具(Cadence\Mentor\\AD\\CAM\ANSYS HFSS)交流学习。

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工程师

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发表于 2014-9-27 20:20:05 | 显示全部楼层
资料不错,不过其中 DQS和DDR CK差分信号阻抗:Z= 100Ω ± 15% ,个人觉得15%公差太大了。建议改成10%以内。
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